Test S+posw4q0-poq0q0-posq0w4s002

AArch64 S+posw4q0-poq0q0-posq0w4s002
"PosWWw4q0 PodWWq0q0 PosWWq0w4 Rfew4w4 PosRRw4q0 PodRWq0q0 PosWWq0w4 Wsew4w4"
Cycle=Rfew4w4 PosRRw4q0 PodRWq0q0 PosWWq0w4 Wsew4w4 PosWWw4q0 PodWWq0q0 PosWWq0w4
Relax=[PosWWw4q0,PodWWq0q0,PosWWq0w4] [PosRRw4q0,PodRWq0q0,PosWWq0w4]
Safe=Rfew4w4 Wsew4w4
Prefetch=0:x=F,0:y=W,1:y=F,1:x=W
Com=Rf Ws
Orig=PosWWw4q0 PodWWq0q0 PosWWq0w4 Rfew4w4 PosRRw4q0 PodRWq0q0 PosWWq0w4 Wsew4w4
{
uint64_t y; uint64_t x; uint64_t 1:X6; uint64_t 1:X2; uint64_t 1:X0;

0:X0=0x3030303; 0:X1=x; 0:X2=0x404040404040404; 0:X3=0x101010101010101; 0:X4=y; 0:X5=0x2020202;
1:X1=y; 1:X3=0x101010101010101; 1:X4=x; 1:X5=0x2020202;
}
 P0             | P1             ;
 STR W0,[X1,#4] | LDR W0,[X1,#4] ;
 STR X2,[X1]    | LDR X2,[X1]    ;
 STR X3,[X4]    | STR X3,[X4]    ;
 STR W5,[X4,#4] | STR W5,[X4,#4] ;
                | LDR X6,[X4]    ;
Observed
    y=0x202020201010101; x=0x202020201010101; 1:X6=0x202020201010101; 1:X2=0x0; 1:X0=0x2020202;